如何消除器件實現超低抖動

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　　級聯PLL芯片支持一個晶體輸入以及一個外部振蕩器輸入。它們通常具有多達10個輸出，使用戶能夠建立一個完整的時鐘系統。本文會對相關知識進行介紹。

　　Microsemi公司的MAX24605和MAX24610是這種類型器件的例子。它們在單個芯片上集成了一個數字PLL和兩個獨立的模擬PLL，具有高達750MHz的輸出頻率范圍。

　　在消除抖動的應用中，它們串聯使用數字和模擬PLL。數字PLL的優點是其帶寬在4Hz至400Hz之間可編程，且數字控制振蕩器使其能夠在數字PLL中實現頻率控制。在同一芯片上提供兩個模擬PLL能夠實現從相同的基準時鐘、或從兩個不同的基準時鐘生成兩個頻率系列。MAX24605和MAX24610提供一個串行外設接口，板載EEPROM存儲器在上電后提供自我配置。

　　使用如上述的抖動消除器件使設計人員能夠實現抖動低至300fs的定時電路。正如本文所示，消除抖動的方法取決于應用的要求和限制。對于一些應用來說，一個特定的低抖動定時器件可能完全沒有必要，因為單靠良好的布局即可將抖動減小到可接受的水平。

　　在需要PLL的應用中，設計人員必須謹慎地指定正確的帶寬。在最極端的情況下，可以通過使用基于級聯PLL拓撲結構的專用抖動消除器件實現超低抖動。

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