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FPGA/CPLD文章列表

喇叭狀鰭片設計可提高針鰭散熱片散熱效率

近年來,尖端FPGA的功能快速發展到了前所未有的高度。但不幸的是,功能方面的快速發展也隨之加大了對散熱的需求。因此,設計人員需要更高效的散熱片來為集成電路提供足夠的降溫需求。 為了滿 ...
2010年04月08日 15:59   |  
喇叭   散熱片   設計   效率  

基于CPLD的USB總線的隔離接口實現

1 引言 大容量數據的高速傳輸是存儲技術的研究的熱點技術,而在工業環境的數據傳輸中抗干擾技術以及醫療設備對人身的安全也是目前研究的熱門課題,USB(Universal Serial Bus)是 “通用串行 ...
2010年04月08日 14:59   |  
CPLD   USB   接口   總線  

基于CPLD的CCD信號發生器的研究

1 引言 CCD (Charge Coupled Devices)電荷藕合器件是20世紀70年代初發展起來的新型半導體 器件。目前CCD作為光電傳感器由于其具有體積小、重量輕、功耗小、工作電壓低和抗燒毀 等優點以及在 ...
2010年04月08日 14:39   |  
CCD   CPLD   發生器   信號   研究  

基于Altera ASI IP核的ASI發送卡實現

1 ASI 接口的應用意義 隨著數字電視技術的迅速發展,在電視節目的制作設計方面己經有很大一部分實現了數 字處理。在節目的傳輸方面,我們從衛星上己可以接收到多套數字壓縮編碼的節目。這種 ...
2010年04月04日 14:47   |  
ALTERA   ASI  

高速異步FIFO的設計與實現

引言 現代集成電路芯片中,隨著設計規模的不斷擴大.一個系統中往往含有數個時鐘。多時鐘帶來的一個問題就是,如何設計異步時鐘之間的接口電路。異步FIFO(First In First Out)是解決這個問題 ...
2010年04月01日 14:11   |  
FIFO   設計   異步  

高速信號采集與數據形成系統硬件設計

1 引言 雷達回波信號工作在很寬的頻帶上,在對回波信號進行采樣時,根據奈奎斯特采樣定理,采樣頻率必須大于等于被采樣信號最高頻率的兩倍,才能使采樣后的信號不失真。這就使得采樣電路丁作 ...
2010年04月01日 13:54   |  
采集   數據   系統   信號   硬件  

基于FPGA的高速圖像采集系統設計

引言 在低速的數據采集系統中,往往采用單片機或者 DSP進行控制;而對于圖像采集這種高速數據采集的場合,這種方案就不能滿足需要。因此這種方案極大浪費了單片機或DSP的端口資源且靈活性差 ...
2010年03月30日 11:58   |  
FPGA   采集   圖像   系統設計  

FPGA中嵌入式存儲器模塊的設計

1 引言 FPGA的片上存儲資源有兩種實現方式:細粒式和粗粒式。所謂細粒式,是指每個基本邏輯單元可以配置成一個小的存儲器.若干個小存儲器冉通過合并進行擴展。它不需要額外邏輯,但存儲密度 ...
2010年03月28日 00:18   |  
FPGA   存儲器   模塊   嵌入式   設計  

FPGA+DSP導引頭信號處理中FPGA設計的關鍵技術

1 引言 隨著同防工業對精確制導武器要求的不斷提高,武器系統總體設計方案的日趨復雜,以及電子元器件水平的飛速發展。導引頭信號處理器的功能越來越復雜,硬件規模越來越大.處理速度也越來 ...
2010年03月27日 23:35   |  
dsp   FPGA   導引頭   關鍵   信號處理  

在低成本FPGA中實現動態相位調整

在FPGA中,動態相位調整(DPA)主要是實現LVDS接口接收時對時鐘和數據通道的相位補償,以達到正確接收的目的。 ALTERA的高端FPGA,如STRATIX(r) 系列中自帶有DPA電路,但低端的FPGA,如CYCLONE(r) ...
2010年03月25日 08:22   |  
FPGA   調整   動態   相位  

現場可編程門陣列的供電

FPGA概述 現場可編程門陣列(FPGA)是一種可編程邏輯器件,由成千上萬個完全相同的可編程邏輯單元組成,周圍是輸入/輸出單元構成的外設。制造完成后,FPGA可以在工作現場編程,以便實現特定的 ...
2010年03月24日 21:55   |  
可編程   現場   陣列  

UTOPIA LEVEL2接口時序分析及FPGA實現

1 引言 在ADSL系統中,由DSLAM(數字用戶接入復用器)完成ATM的終結和路由。該模型分為4層,自上而下分為高層、從AAL層、ATM層和物理層。這里高層是指RFCl483及其以上各層,AAL層(ATM適配層)又 ...
2010年03月24日 11:25   |  
FPGA   UTOPIA   接口   時序  

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