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FPGA/CPLD文章列表

零基礎學FPGA(十七)Testbench 很重要,前仿真全過程筆記(上篇)

零基礎學FPGA(十七)Testbench 很重要,前仿真全過程筆記(上篇)

作者:小墨同學 剛剛做完了高頻實驗,說實話真是做的一頭霧水。還是那種感覺,真是沒什么用,所有人拿著早已經復制好的電路圖,打開軟件運行一下,再跟助教說一聲做完了,隨便打個分就可 ...
2015年01月20日 14:14   |  
testbench   零基礎   FPGA   小墨同學  
零基礎學FPGA(十六)第一片IC——精簡指令集RISC_CPU設計精講

零基礎學FPGA(十六)第一片IC——精簡指令集RISC_CPU設計精講

小墨同學 不得不說,SDRAM的設計是我接觸FPGA以來調試最困難的一次設計,早在一個多月以前,我就開始著手想做一個SDRAM方面的教程,受特權同學影響,開始學習《高手進階,終極內存技術 ...
2015年01月20日 14:03   |  
小墨同學   RISC   零基礎   FPGA  
零基礎學FPGA(十五)先來說說VGA

零基礎學FPGA(十五)先來說說VGA

作者:小墨同學 這個實驗其實已經做好久了,但是一直沒有做筆記,今天就把這部分的內容補一下,有興趣的朋友可以看一下,或許對你有什么幫助,對初學者來說還是一個不錯的實驗。 ...
2015年01月20日 13:52   |  
零基礎   FPGA   VGA   小墨同學  

零基礎學FPGA(十三)對于初學者一篇很不錯的文章

作者:小墨同學 長期以來很多新入群的菜鳥們總 是在重復的問一些非常簡單但是又讓新手困惑不解的問題。作為管理員經常要給這些菜鳥們普及基礎知識,但是非常不幸的是很多菜鳥懷著一種浮躁的 ...
2015年01月20日 13:30   |  
小墨同學   零基礎   FPGA  
零基礎學FPGA(十二)一步一腳印之基于FIFO的串口發送機設計全流程及常見錯誤詳解

零基礎學FPGA(十二)一步一腳印之基于FIFO的串口發送機設計全流程及常見錯誤詳解

作者:小墨同學 記得在上幾篇博客中,有幾名網友提出要加進去錯誤分析這一部分,那我們就從今天這篇文章開始加進去我在消化這段代碼的過程中遇到的迷惑,與大家分享。 今天 ...
2015年01月20日 11:30   |  
小墨同學   零基礎   FPGA   FIFO   串口發送機  
零基礎學FPGA(十一)初入江湖之i2c通信

零基礎學FPGA(十一)初入江湖之i2c通信

作者:小墨同學 相信學過單片機的同學對I2C總線都不陌生吧,今天我們來學習怎么用verilog語言來實現它,并在FPGA學習版上顯示。 i2c總線在近年來微電子通信控制領域廣泛采用的一 ...
2015年01月20日 11:07   |  
小墨同學   零基礎   FPGA   i2c  

基于單片機和FPGA設計的程控濾波器

以單片機和可編程邏輯器件(FPGA)為控制核心,設計了一個程控濾波器,實現了小信號程控放大、程控調整濾波器截止頻率和幅頻特性測試的功能。其中放大模塊由可變增益放大器AD603實現,最大 ...
2015年01月15日 15:00   |  
程控濾波器   可變增益放大   截止頻率可調   幅度測量  
零基礎學FPGA(十)牛刀小試——串行口通信電路設計

零基礎學FPGA(十)牛刀小試——串行口通信電路設計

作者:小墨同學 以前在學單片機的時候,覺得串口通信其實很簡單,只要一個指令數據就能輕易的接收或者發送。前幾天試著用FPGA實現,發現里面的學問還不少,并沒有想象的那么簡單。當然 ...
2015年01月14日 15:10   |  
零基礎   FPGA   小墨同學  
零基礎學FPGA(九)手把手解析時序邏輯乘法器代碼

零基礎學FPGA(九)手把手解析時序邏輯乘法器代碼

作者:小墨同學 上次看了一下關于乘法器的Verilog代碼,有幾個地方一直很迷惑,相信很多初學者看這段代碼一定跟我當初一樣,看得一頭霧水,在網上也有一些網友提問,說這段代碼不好理 ...
2015年01月14日 15:01   |  
零基礎   FPGA   時序邏輯   乘法器  
零基礎學FPGA(八)淺談狀態機

零基礎學FPGA(八)淺談狀態機

作者:小墨同學 關于狀態機呢,想必大家應該都接觸過,通俗的講就是數電里我們學的狀態轉換圖。狀態機分為兩中類型,一種叫Mealy型,一種叫Moore型。前者就是說時序邏輯的輸出不僅取決于當前 ...
2015年01月14日 14:57   |  
小墨同學   狀態機   零基礎   FPGA  
零基礎學FPGA(五)Verilog語法基基礎基礎(下)

零基礎學FPGA(五)Verilog語法基基礎基礎(下)

作者:小墨同學 9、關于任務和函數的小結,挑幾點重要的說一下吧 (1)任務具有多個輸入、輸入/輸出和輸出變量,在任務重可以使用延遲、事件和時序控制結構,在任務重可以調用其它任務和函 ...
2015年01月14日 14:35   |  
零基礎   FPGA   Verilog   小墨同學  
零基礎學FPGA(四)Verilog語法基基礎基礎(中)

零基礎學FPGA(四)Verilog語法基基礎基礎(中)

作者:小墨同學 我們接著上篇文章繼續學習,上次提到了兩種賦值語句,讓我們接著往下學。 1、塊語句 塊語句包括兩種,一個是順序塊,一個是并行塊。 (1)順序快 順 ...
2015年01月14日 14:18   |  
小墨同學   零基礎   FPGA   Verilog  

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