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Xilinx大學(xué)合作指定教材：Verilog HDL程序設(shè)計(jì)與實(shí)踐

發(fā)布時(shí)間：2010-7-6 14:44    發(fā)布者：看門狗
關(guān)鍵詞： HDL , verilog
云創(chuàng)工作室編著

Verilog HDL程序設(shè)計(jì)與實(shí)踐（云創(chuàng)工作室）.part1.rar (4.77 MB)
Verilog HDL程序設(shè)計(jì)與實(shí)踐（云創(chuàng)工作室）.part2.rar (4.77 MB)
Verilog HDL程序設(shè)計(jì)與實(shí)踐（云創(chuàng)工作室）.part3.rar (4.42 MB)
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youyou_zh 發(fā)表于 2010-9-8 21:13:04
hao
isbrand 發(fā)表于 2010-11-13 22:06:19
hao
isbrand 發(fā)表于 2010-11-13 22:09:29
thanks
meanwe451 發(fā)表于 2011-7-30 21:48:24
好資料！！！
huiyanhuishi 發(fā)表于 2011-7-31 08:54:28
好資料，已經(jīng)下載了��！
sunt8707 發(fā)表于 2011-8-11 10:03:49
不知道怎么樣啊，謝謝了
xiaoleisl 發(fā)表于 2011-9-25 17:06:28
hao
bluesky_jian 發(fā)表于 2011-11-22 13:32:14
Thank you very much
xiaoleisl 發(fā)表于 2011-12-1 12:00:44
xiexei
zhuhuagui 發(fā)表于 2012-6-3 15:37:47
好資料，謝謝！
雪豹 發(fā)表于 2013-11-2 15:50:07
jiangtao1027 發(fā)表于 2014-9-27 22:14:25
hao
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