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FPGA實(shí)戰(zhàn)演練邏輯篇30:FT232之UART電路設(shè)計(jì)

發(fā)布時(shí)間:2015-5-29 10:17    發(fā)布者:rousong1989
FT232之UART電路設(shè)計(jì)
本文節(jié)選自特權(quán)同學(xué)的圖書《FPGA設(shè)計(jì)實(shí)戰(zhàn)演練(邏輯篇)》
配套例程下載鏈接:http://pan.baidu.com/s/1pJ5bCtt
FT232芯片內(nèi)部功能框圖如圖6.68所示。它通過USB的D+/D-與PC進(jìn)行通信,芯片內(nèi)部能夠根據(jù)USB協(xié)議對數(shù)據(jù)進(jìn)行處理,最終通過FIFO將這些數(shù)據(jù)轉(zhuǎn)換為UART協(xié)議和我們的FPGA進(jìn)行通信。(特權(quán)同學(xué),版權(quán)所有)
圖6.68 FT232芯片內(nèi)部功能框圖
         FT232R的接口電路如圖6.69所示。P4為USB port,用于連接PC,UART_TX和UART_RX分別為FT232R芯片的UART發(fā)送和UART接收信號,對應(yīng)的,UART_TX就是FPGA的UART接收,而UART_RX就是FPGA的UART發(fā)送信號。D2和D3連接著U2-23/22,在UART_RX和UART_TX收發(fā)的時(shí)候它們會閃爍以指示工作狀態(tài)。(特權(quán)同學(xué),版權(quán)所有)
圖6.69 FT232接口電路
         FT232R的引腳定義如表3.8所示。(特權(quán)同學(xué),版權(quán)所有)
表3.8 FT232引腳定義
  
引腳號
  
引腳名稱
類型
說明
15
USBDP
I/O
USB差分信號正,內(nèi)部集成串聯(lián)電阻和1.5K ohm上拉到3.3V。
16
USBDM
I/O
USB差分信號負(fù),內(nèi)部集成串聯(lián)電阻。
4
VCCIO
PWR
I/O供電電壓
7,18,21
GND
PWR
芯片的地引腳。
17
3V3OUT
O
經(jīng)過內(nèi)部LDO輸出的3.3V電壓,最大供電電流50mA。
20
VCC
PWR
芯片核電壓,可以供3.3V~5.25V。
25
AGND
PWR
用于內(nèi)部時(shí)鐘倍頻的模擬地。
8,24
NC
NC
無連接。
19
RESET#
I
復(fù)位引腳,低電平有效。內(nèi)部有上拉電阻,不使用該引腳可以浮空。
26
TEST
I
內(nèi)部測試引腳,正常工作是必須接地。
27
OSCI
I
12MHz晶體輸入引腳。
28
OSCO
O
12MHz晶體輸出引腳。
1
TXD
O
芯片的UART數(shù)據(jù)發(fā)送信號。
2
DRT#
O
數(shù)據(jù)終端準(zhǔn)備控制輸出/握手信號。
3
RTS#
O
請求發(fā)送控制輸出/握手信號。
5
RXD
I
芯片的UART數(shù)據(jù)接收信號。
6
RI#
I
振鈴提示控制輸入信號。
9
DSR#
I
數(shù)據(jù)設(shè)置準(zhǔn)備控制輸入/握手信號。
10
DCD#
I
數(shù)據(jù)傳輸檢測控制輸入。
11
CTS#
I
清除發(fā)送控制輸入/握手信號。
12
CBUS4
I/O
可配置CBUS輸出引腳。
13
CBUS2
I/O
可配置CBUS輸出引腳。
14
CBUS3
I/O
可配置CBUS輸出引腳。
22
CBUS1
I/O
可配置CBUS輸出引腳。
23
CBUS0
I/O
可配置CBUS輸出引腳。

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