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FPGA實戰(zhàn)演練邏輯篇33：實時時鐘芯片電路設(shè)計

發(fā)布時間：2015-6-5 11:52    發(fā)布者：rousong1989
實時時鐘芯片電路設(shè)計
本文節(jié)選自特權(quán)同學(xué)的圖書《FPGA設(shè)計實戰(zhàn)演練（邏輯篇）》
配套例程下載鏈接：http://pan.baidu.com/s/1pJ5bCtt
         如圖3.76所示，U2是一顆實時時鐘（RTC）芯片，該芯片需要外部供32.768KHz的時鐘晶體，這個晶體的振蕩需要借助一顆30Pf(8pF)的電容。該芯片和FPGA之間通過I2C總線接口進(jìn)行數(shù)據(jù)傳輸。該芯片的供電要借助外部連接的一顆紐扣電池。（特權(quán)同學(xué)，版權(quán)所有）
圖3.76 實時時鐘接口電路
         U2的各個引腳定義如表3.13所示。（特權(quán)同學(xué)，版權(quán)所有）
表3.13 實時時鐘芯片的引腳定義
  
引腳
  
信號
功能
1
OSCI
32.768KHz晶體輸入引腳。
2
OSCO
32.768KHz晶體輸出引腳。
3
INT#
RTC芯片中斷產(chǎn)生引腳。
4
DGND
電源地。
5
SDA
用于讀寫寄存器的I2C總線數(shù)據(jù)信號。
6
SCL
用于讀寫寄存器的I2C總線時鐘信號。
7
CLKOUT
時鐘輸出引腳，本實例不使用，直接懸空。
8
VDD
芯片電源輸入，連接到3V的紐扣電池供電。

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