例說FPGA連載32：PLL例化配置與LED之使用Pin Planner進(jìn)行引腳分配

rousong1989

例說FPGA連載32：PLL例化配置與LED之使用Pin Planner進(jìn)行引腳分配

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如圖3.18所示，點(diǎn)擊菜單欄“AssignmentsàPin Planner”。

圖3.18 菜單選擇Pin Planner

在彈出的“Pin Planner”中，找到如圖3.19所示的“All Pins”選項(xiàng)卡�！�Node Name”羅列了所有在設(shè)計(jì)工程的頂層代碼中申明過的引腳信號(hào)，我們找到它們所對(duì)應(yīng)的“Location”列，這里可以輸入或者查找相應(yīng)的引腳進(jìn)行分配。

圖3.19 Pin Planner界面

        如圖3.20所示，我們給ext_clk對(duì)應(yīng)的Location列輸入了引腳號(hào)“E15”。這就完成了ext_clk信號(hào)的引腳分配。

圖3.20 Pin Planner引腳分配

        引腳分配是基于什么？拍拍腦袋，隨心所欲？非也，引腳的分配一定是有理有據(jù)，那就是我們已經(jīng)設(shè)計(jì)好的硬件原理圖。如圖3.21所示，這里FPGA所使用的時(shí)鐘信號(hào)ext_clk對(duì)應(yīng)原理圖上的網(wǎng)絡(luò)名CLK_25M，它的FPGA引腳號(hào)是E15，那么我們就給它分配E15。

圖3.21 時(shí)鐘信號(hào)的引腳連接原理圖

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xiboliyalang

十分不錯(cuò)

xiboliyalang

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