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PCI-SIG發(fā)布CopprLink線(xiàn)纜規(guī)范 適用于PCIe 5.0和6.0標(biāo)準(zhǔn)

發(fā)布時(shí)間:2024-5-5 10:34    發(fā)布者:eechina
關(guān)鍵詞: PCI-SIG , CopprLink , PCIe
來(lái)源:EXPreview

去年11月,PCI-SIG在美國(guó)丹佛科羅拉多會(huì)議中心舉行了SC23會(huì)議,向成員展示了PCIe技術(shù)演示和新的PCI快速線(xiàn)纜命名方案,強(qiáng)調(diào)了PCIe技術(shù)是高性能計(jì)算互連的首選。PCI-SIG表示,PCIe內(nèi)部和外部線(xiàn)纜新命名方案為“CopprLink”,相關(guān)規(guī)范正在制定當(dāng)中,將滿(mǎn)足PCIe 5.0和PCIe 6.0標(biāo)準(zhǔn)的使用要求。

現(xiàn)在PCI-SIG終于發(fā)布了CopprLink內(nèi)部和外部線(xiàn)纜規(guī)范,適用于PCIe 5.0和PCIe 6.0標(biāo)準(zhǔn),提供了32/64 GT/s的信號(hào)傳輸速率,并利用了由SNIA維護(hù)的成熟行業(yè)標(biāo)準(zhǔn)連接器外形尺寸。PCI-SIG原來(lái)打算在2023年內(nèi)發(fā)布,已經(jīng)晚了小半年了。



PCI-SIG總裁兼主席Al Yanes表示,CopprLink線(xiàn)纜規(guī)范將PCIe布線(xiàn)與PCIe電氣基礎(chǔ)規(guī)范無(wú)縫集成,提供了更長(zhǎng)的通道覆蓋范圍和拓?fù)潇`活性。CopprLink線(xiàn)纜旨在與相同的連接器外形尺寸一起發(fā)展,適應(yīng)未來(lái)PCIe技術(shù)的發(fā)展,并滿(mǎn)足新興應(yīng)用的需求。

CopprLink內(nèi)部線(xiàn)纜規(guī)范:

· 支持PCIe 5.0/6.0標(biāo)準(zhǔn)的信號(hào),速率分別為32/64 GT/s
· 包括SNIA SFF-TA-1016連接器外形尺寸
· 單個(gè)系統(tǒng)內(nèi)的最大傳輸距離為1米
· 實(shí)施示例包括獨(dú)立服務(wù)器平臺(tái)節(jié)點(diǎn)中的主板到擴(kuò)展卡、主板到背板、芯片到芯片以及擴(kuò)展卡到背板
· 目標(biāo)應(yīng)用包括存儲(chǔ)和數(shù)據(jù)中心計(jì)算節(jié)點(diǎn)

CopprLink外部線(xiàn)纜規(guī)范:

· 支持PCIe 5.0/6.0標(biāo)準(zhǔn)的信號(hào),速率分別為32/64 GT/s
· 包括SNIA SFF-TA-1032連接器外形尺寸
· 在機(jī)架到機(jī)架的連接中最長(zhǎng)可達(dá)2米
· 實(shí)施示例包括分解服務(wù)器平臺(tái)節(jié)點(diǎn)中的CPU到存儲(chǔ)、CPU到內(nèi)存、CPU到加速器、以及CPU到服務(wù)器平臺(tái)節(jié)點(diǎn)中的加速器結(jié)構(gòu)
· 目標(biāo)應(yīng)用包括存儲(chǔ)和數(shù)據(jù)中心AI/ML用例

CopprLink內(nèi)部和外部線(xiàn)纜規(guī)范資料已經(jīng)提供給PCI-SIG成員下載,同時(shí)針對(duì)128 GT/s的PCIe 7.0 標(biāo)準(zhǔn)的CopprLink線(xiàn)纜相關(guān)工作已經(jīng)在進(jìn)行當(dāng)中,這表明了PCI-SIG對(duì)CopprLink線(xiàn)纜規(guī)范的承諾。
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