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FPGA/CPLD文章列表

FPGA面試筆試數(shù)電部分

1:什么是同步邏輯和異步邏輯?(漢王) 同步邏輯是時(shí)鐘之間有固定的因果關(guān)系。異步邏輯是各時(shí)鐘之間沒(méi)有固定的因果關(guān)系。 答案應(yīng)該與上面問(wèn)題一致 〔補(bǔ)充〕:同步時(shí)序邏輯電路的特點(diǎn):各觸發(fā) ...
2011年12月29日 22:18   |  
FPGA   筆試   面試  
分析M16C62在uC/OS-II嵌入式系統(tǒng)中的應(yīng)用

分析M16C62在uC/OS-II嵌入式系統(tǒng)中的應(yīng)用

隨著微電子技術(shù)和網(wǎng)絡(luò)的發(fā)展,人們對(duì)網(wǎng)絡(luò)的認(rèn)識(shí)日益深入。網(wǎng)絡(luò)終端產(chǎn)品也越來(lái)越受到人們的關(guān)注,嵌入式操作系統(tǒng)的應(yīng)用也得到了前所未有的發(fā)展,人們對(duì)嵌入式的研究也有了長(zhǎng)足的進(jìn)步。基于某個(gè)操 ...
2011年12月22日 22:34   |  
M16C62   嵌入式系統(tǒng)  
基于FPGA的AMLCD控制器的設(shè)計(jì)

基于FPGA的AMLCD控制器的設(shè)計(jì)

飛機(jī)座艙圖形顯示系統(tǒng)已發(fā)展到第六代,即采用有源矩陣彩色液晶顯示器AMLCD(ActiveMatrixLiquidCrystalDisplay)。當(dāng)前高分辨率的軍用AMLCD顯示模塊還只能依靠進(jìn)口,且控制電路板須安裝在該顯示 ...
2011年12月21日 23:07   |  
AMLCD控制器   FPGA  
M24LR64-R:13.56 MHz雙接口EEPROM開發(fā)方案

M24LR64-R:13.56 MHz雙接口EEPROM開發(fā)方案

ST公司的M24LR64-R是無(wú)線存儲(chǔ)器,具有口令保護(hù)的64kbits EEPROM以及400kHz I2C串行總線和13.56MHz ISO 15693 RF協(xié)議的雙接口的64kbits EEPROM,可實(shí)現(xiàn)智能手機(jī)的近場(chǎng)通信(NFC)。單電源1.8V~5. ...
2011年12月12日 20:20   |  
eeprom   M24LR64-R   接口  
51單片機(jī)加CPLD讓系統(tǒng)更高效

51單片機(jī)加CPLD讓系統(tǒng)更高效

  一、引言   單片機(jī)市場(chǎng)可以用巨無(wú)霸來(lái)形容,其中51 單片機(jī)使用者就更多了,針對(duì)51 單片機(jī)無(wú)需更多的介紹,這里必須強(qiáng)調(diào)一點(diǎn),只要你精通了51 單片機(jī),以后在實(shí)際工作中選用其它單片機(jī) ...
2011年12月06日 22:40   |  
51   CPLD   單片機(jī)   接口設(shè)計(jì)  
提高FPGA設(shè)計(jì)效能的方案

提高FPGA設(shè)計(jì)效能的方案

隨著FPGA密度的增加,系統(tǒng)設(shè)計(jì)人員能夠開發(fā)規(guī)模更大、更復(fù)雜的設(shè)計(jì),從而將密度優(yōu)勢(shì)發(fā)揮到最大。這些大規(guī)模設(shè)計(jì)基于這樣的設(shè)計(jì)需求——需要在無(wú)線通道卡或者線路卡等現(xiàn)有應(yīng)用中加入新功能,或者 ...
2011年11月30日 16:39   |  
FPGA   設(shè)計(jì)效能  
基于FPGA的行間轉(zhuǎn)移面陣CCD驅(qū)動(dòng)電路設(shè)計(jì)

基于FPGA的行間轉(zhuǎn)移面陣CCD驅(qū)動(dòng)電路設(shè)計(jì)

1、引言電荷耦合器件(CCD)是一種光電轉(zhuǎn)換式圖像傳感器,它將圖像信號(hào)直接轉(zhuǎn)換成電信號(hào)。由于CCD具有集成度高、低功耗、低噪聲、測(cè)量精度高、壽命長(zhǎng)等諸多優(yōu)點(diǎn),因此在精密測(cè)量、非接觸無(wú)損檢 ...
2011年11月30日 16:33   |  
CCD   FPGA   驅(qū)動(dòng)電路   行間轉(zhuǎn)移面陣  
基于FPGA的高速流水線浮點(diǎn)乘法器設(shè)計(jì)與實(shí)現(xiàn)

基于FPGA的高速流水線浮點(diǎn)乘法器設(shè)計(jì)與實(shí)現(xiàn)

1引言 在數(shù)字化飛速發(fā)展的今天,人們對(duì)微處理器的性能要求也越來(lái)越高。作為衡量微處理器性能的主要標(biāo)準(zhǔn),主頻和乘法器運(yùn)行一次乘法的周期息息相關(guān)。因此,為了進(jìn)一步提高微處理器性能,開發(fā)高 ...
2011年11月30日 16:26   |  
FPGA   浮點(diǎn)乘法器   高速流水線  
Xilinx FPGA的Fast Startup

Xilinx FPGA的Fast Startup

  在眾多當(dāng)代應(yīng)用中,嵌入式系統(tǒng)必須滿足極其苛刻的時(shí)序要求。其中之一就是啟動(dòng)時(shí)間——即上電后電子系統(tǒng)進(jìn)入可操作狀態(tài)所需要的時(shí)間。PCI Express®產(chǎn)品或汽車應(yīng)用中基于CAN的電子控制單 ...
2011年11月10日 17:50   |  
Fast Startup   Xilinx FPGA  
基于FPGA的LED體三維顯示設(shè)計(jì)方案

基于FPGA的LED體三維顯示設(shè)計(jì)方案

  摘 要: 基于人眼視覺暫留特性及LED 的高速發(fā)光特性, 設(shè)計(jì)了一套LED 體三維顯示系統(tǒng)。首先利用Matlab 生成三維數(shù)據(jù), 通過(guò)紅外模塊傳輸?shù)斤@示驅(qū)動(dòng)電路; 其次快速旋轉(zhuǎn)LED 陣列, 由角度編 ...
2011年11月10日 11:08   |  
FGPA   角度編碼器   體三維顯示   現(xiàn)場(chǎng)可編程門陣列  

FPGA與GPS_OEM板的UART設(shè)計(jì)

引言 UART(標(biāo)準(zhǔn)異步接收器/發(fā)射器)得到了相當(dāng)廣泛的應(yīng)用,它允許串行鏈路上進(jìn)行全雙工通信。一般使用通用的UART接口芯片,但這種芯片存在電路復(fù)雜、成本高,降低了系統(tǒng)的可靠性和穩(wěn)定度,由 ...
2011年10月31日 10:29   |  
FPGA   UART  

Altera白皮書:基于ARM 的SoC FPGA

用戶可定制基于ARM 的SoC FPGA,適用于下一代嵌入式系統(tǒng) 本白皮書討論用于實(shí)現(xiàn)基于ARM 的嵌入式系統(tǒng)的Altera 可編程芯片系統(tǒng)(SoC) 方法。對(duì)于面臨產(chǎn)品及時(shí)面市、成本、性能、設(shè)計(jì)重用和產(chǎn)品 ...
2011年10月24日 09:36   |  
FPGA Altera 虛擬目標(biāo)   SoC FPGA  

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