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FPGA/CPLD文章列表

基于MicroBlaze軟核的FPGA片上系統(tǒng)設(shè)計(jì)

  Xilinx公司的MicroBlaze 32位軟處理器核是支持CoreConnect總線的標(biāo)準(zhǔn)外設(shè)集合。MicroBlaze處理器運(yùn)行在150MHz時(shí)鐘下,可提供125 D-MIPS的性能,非常適合設(shè)計(jì)針對(duì)網(wǎng)絡(luò)、電信、數(shù)據(jù)通信和消費(fèi) ...
2015年11月10日 13:23   |  
MicroBlaze   Xilinx   FPGA  

基于ISE設(shè)計(jì)提供低功耗FPGA解決方案

  從Xilinx公司推出FPGA二十多年來(lái),研發(fā)工作大大提高了FPGA的速度和面積效率,縮小了FPGA與ASIC之間的差距,使FPGA成為實(shí)現(xiàn)數(shù)字電路的優(yōu)選平臺(tái)。今天,功耗日益成為FPGA供應(yīng)商及其客戶(hù)關(guān)注的 ...
2015年11月10日 11:15   |  
FPGA   ISE  

FPGA設(shè)計(jì)開(kāi)發(fā)軟件ISE使用技巧之:典型實(shí)例-ChipScope功能演示

  6.8 典型實(shí)例11:ChipScope功能演示   6.8.1 實(shí)例的內(nèi)容及目標(biāo)   1.實(shí)例的主要內(nèi)容   本節(jié)通過(guò)一個(gè)簡(jiǎn)單的計(jì)數(shù)器,使用ChipScope的兩種實(shí)現(xiàn)流程,基于Xilinx開(kāi)發(fā)板完成設(shè)計(jì)至驗(yàn)證的 ...
2015年11月10日 11:15   |  
FPGA   ISE  

基于京微雅格低功耗FPGA的8b/10b SERDES的接口設(shè)計(jì)

  摘要   串行接口常用于芯片至芯片和電路板至電路板之間的數(shù)據(jù)傳輸。隨著系統(tǒng)帶寬不斷增加至多吉比特范圍,并行接口已經(jīng)被高速串行鏈接,或SERDES (串化器/ 解串器)所取代。起初, SERDES ...
2015年11月10日 11:14   |  
京微雅格   FPGA  

FPGA時(shí)序約束的6種方法

  對(duì)自己的設(shè)計(jì)的實(shí)現(xiàn)方式越了解,對(duì)自己的設(shè)計(jì)的時(shí)序要求越了解,對(duì)目標(biāo)器件的資源分布和結(jié)構(gòu)越了解,對(duì)EDA工具執(zhí)行約束的效果越了解,那么對(duì)設(shè)計(jì)的時(shí)序約束目標(biāo)就會(huì)越清晰,相應(yīng)地,設(shè)計(jì)的 ...
2015年11月10日 11:10   |  
FPGA   時(shí)序約束  
Xilinx FPGA入門(mén)連載23:PLL實(shí)例之功能簡(jiǎn)介

Xilinx FPGA入門(mén)連載23:PLL實(shí)例之功能簡(jiǎn)介

Xilinx FPGA入門(mén)連載23:PLL實(shí)例之功能簡(jiǎn)介特權(quán)同學(xué),版權(quán)所有配套例程和更多資料下載鏈接:http://pan.baidu.com/s/1jGjAhEm 1 PLL概述PLL(Phase Locked Loop):為鎖相回路或鎖相環(huán),用來(lái)統(tǒng)一 ...
2015年11月10日 08:21

利用 Virtex-5 SXT 的高性能 DSP 解決方案

  二十多年來(lái),F(xiàn)PGA 為世人提供了最靈活、適應(yīng)性極強(qiáng)、快速的設(shè)計(jì)環(huán)境。早期的 DSP 設(shè)計(jì)人員發(fā)現(xiàn),可將一種可再編程的門(mén)海用于數(shù)字信號(hào)處理。如果把內(nèi)置到 FPGA 架構(gòu)中的乘法器、加法器和累加 ...
2015年11月09日 14:39   |  
Virtex-5   DSP  

使用Virtex-5 FPGA實(shí)現(xiàn)LTE仿真器

  功能強(qiáng)大的可編程邏輯平臺(tái)使得Prisma Engineering公司能夠針對(duì)所有蜂窩網(wǎng)絡(luò)提供可重配置無(wú)線測(cè)試設(shè)備。長(zhǎng)期演進(jìn)(LTE)是移動(dòng)寬帶的最3GPP標(biāo)準(zhǔn),它打破了現(xiàn)有蜂窩網(wǎng)絡(luò)的固有模式。LTE與前代UM ...
2015年11月09日 14:38   |  
Virtex-5   FPGA   仿真器  

FPGA的FIR抽取濾波器設(shè)計(jì)

  用FPGA實(shí)現(xiàn)抽取濾波器比較復(fù)雜,主要是因?yàn)樵贔PGA中缺乏實(shí)現(xiàn)乘法運(yùn)算的有效結(jié)構(gòu),現(xiàn)在,F(xiàn)PGA中集成了硬件乘法器,使FPGA在數(shù)字信號(hào)處理方面有了長(zhǎng)足的進(jìn)步。本文介紹了一種采用Xilinx公司的 ...
2015年11月09日 14:23   |  
FPGA   FIR  

FPGA在數(shù)字信號(hào)處理中的簡(jiǎn)單應(yīng)用

  數(shù)字信號(hào)處理技術(shù)已經(jīng)成功運(yùn)用于信號(hào)地濾波、語(yǔ)音、圖像、音頻、信息系統(tǒng)、控制和儀表設(shè)備。可編程數(shù)字信號(hào)處理器在20 世紀(jì)70 年代地引入更是使DSP 技術(shù)突飛猛進(jìn),取得巨大成功,這些PDSP ...
2015年11月09日 14:22   |  
FPGA   信號(hào)處理  

如何用PMIC快速、輕松且劃算的為FPGA供電

  如果你是一名研究現(xiàn)場(chǎng)可編程門(mén)陣列(FPGA)的工程師,你就應(yīng)該知道這些器件的高效運(yùn)行需要優(yōu)化的電源序列。使用離散組件來(lái)滿(mǎn)足這些特定的電源需求通常需要一個(gè)額外的離散排序器或微控制器。然 ...
2015年11月09日 14:19   |  
PMIC   FPGA  
Xilinx FPGA入門(mén)連載22:經(jīng)典模式流水燈實(shí)驗(yàn)

Xilinx FPGA入門(mén)連載22:經(jīng)典模式流水燈實(shí)驗(yàn)

Xilinx FPGA入門(mén)連載22:經(jīng)典模式流水燈實(shí)驗(yàn)特權(quán)同學(xué),版權(quán)所有配套例程和更多資料下載鏈接:http://pan.baidu.com/s/1jGjAhEm 1 功能簡(jiǎn)介 本實(shí)例使用一個(gè)撥碼開(kāi)關(guān)和2個(gè)導(dǎo)航按鍵控制流 ...
2015年11月06日 13:32

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