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FPGA/CPLD文章列表

Xilinx FPGA入門連載26:數碼管驅動實例

Xilinx FPGA入門連載26:數碼管驅動實例

Xilinx FPGA入門連載26:數碼管驅動實例特權同學,版權所有配套例程和更多資料下載鏈接:http://pan.baidu.com/s/1jGjAhEm 1 數碼管驅動原理 先來了解一下數碼管的工作原理。如圖所示, ...
2015年11月20日 11:03
Xilinx FPGA入門連載25:PLL實例之模塊化設計

Xilinx FPGA入門連載25:PLL實例之模塊化設計

Xilinx FPGA入門連載25:PLL實例之模塊化設計特權同學,版權所有配套例程和更多資料下載鏈接:http://pan.baidu.com/s/1jGjAhEm 1 模塊化設計概述 模塊化設計是FPGA設計中一個很重要的 ...
2015年11月18日 13:18
Xilinx FPGA入門連載24:PLL實例之基本配置

Xilinx FPGA入門連載24:PLL實例之基本配置

Xilinx FPGA入門連載24:PLL實例之基本配置特權同學,版權所有配套例程和更多資料下載鏈接:http://pan.baidu.com/s/1jGjAhEm 1 工程移植 可以復制上一個實例sp6ex7的整個工程文件夾, ...
2015年11月16日 11:07

一種基于CPLD實現QPSK調制電路設計

  QPSK是數字通信系統中一種常用的多進制調制方式。其調制的基本原理:對輸入的二進制序列按每兩位碼元分為一組,用載波的四種相位表征它們。實際上QPSK信號是兩路正交雙邊帶信號,F在人們對 ...
2015年11月13日 09:57   |  
CPLD   QPSK   調制  

反熔絲FPGA在密碼芯片設計中的運用

  詳細介紹了反熔絲FPGA在提高密碼芯片速度和對密碼算法進行保護方面的應用,并給出了密碼算法芯片中部分模塊的實現方法。   1引言   隨著計算機和通信的發展,信息傳輸過程中信息安全 ...
2015年11月12日 15:33   |  
FPGA   反熔絲   QUICKLOGIC  

基于FPGA的混沌加密虹膜識別系統設計(二)

  7.1.3 虹膜外邊緣的確定   (1) 虹膜外邊緣的特征分析   由圖1中所示的虹膜圖像可以看出,虹膜外邊緣的主要特點是:較相對與虹膜內邊緣而言,邊緣處灰度變化不是特別明顯,有一小段漸 ...
2015年11月12日 10:57   |  
FPGA   虹膜識別   CMOS  

基于FPGA的混沌加密虹膜識別系統設計(一)

  項目信息   1.項目名稱:基于FPGA的混沌加密虹膜識別系統設計   2.應用領域:工業控制、科研、醫療、安檢   3.設計摘要:   基于虹膜的生物識別技術是一種最新的識別技術,通過 ...
2015年11月12日 10:56   |  
FPGA   虹膜識別   CMOS  

基于FPGA的簡易頻譜分析儀

  1 引言   目前,由于頻譜分析儀價格昂貴,高等院校只是少數實驗室配有頻譜儀。但電子信息類教學,如果沒有頻譜儀輔助觀察,學生只能從書本中抽象理解信號特征,嚴重影響教學實驗效果。 ...
2015年11月12日 10:55   |  
FPGA   頻譜分析儀   AD603  

基于Verilog HDL的SPWM全數字算法的FPGA實現

  隨著信號處理技術及集成電路制造工藝的不斷發展,全數字化SPWM(正弦脈寬調制)算法在調速領域越來越受到青睞。實現SPWM控制算法的方法很多,其中模擬比較法因電路復雜、且不易與數字系統連接 ...
2015年11月12日 10:50   |  
Verilog   HDL   SPWM   FPGA  

基于FPGA的Viterbi譯碼器設計及實現

  卷積碼是廣泛應用于衛星通信、無線通信等各種通信系統的信道編碼方式。Viterbi算法是一種最大似然譯碼算法。在碼的約束度較小時,它比其它概率譯碼算法效率更高、速度更快,譯碼器的硬件結 ...
2015年11月12日 10:17   |  
FPGA   Viterbi   譯碼器  

基于FPGA的脫機手寫體漢字識別系統

  1設計摘要   1.1項目背景   漢字作為非字母化、非拼音化的文字,在當今高度信息化的社會里,如何快速高效地將漢字輸入計算機,已成為影響人機交流信息效率的一個重要瓶頸。目前,漢字 ...
2015年11月12日 10:15   |  
FPGA   神經網絡   漢字識別  

一種節能型可升級異步FIFO的FPGA實現

  現代數字系統中,異步FIFO是一種被廣泛應用于跨時鐘域進行數據傳輸的有效方式。異步FIFO主要應用于兩種不同時鐘域的數據傳輸,這意味著數據的寫入在一個時鐘域,而數據的讀出卻在另一個時鐘 ...
2015年11月11日 14:11   |  
FIFO   FPGA  

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