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FPGA/CPLD文章列表

FPGA實戰演練邏輯篇21:引腳分配規劃和擴展IO電路

FPGA實戰演練邏輯篇21:引腳分配規劃和擴展IO電路

引腳分配規劃和擴展I/O電路本文節選自特權同學的圖書《FPGA設計實戰演練(邏輯篇)》配套例程下載鏈接:http://pan.baidu.com/s/1pJ5bCtt 核心板上專門留了一個LED指示燈連接到FPGA引 ...
2015年05月06日 11:09

迎接可穿戴設備時代的設計挑戰

可穿戴電子設備對設計工程師提出了前所未有的挑戰—設計工程師需要在沒有專用芯片組或標準化架構的情況下創建智能、緊湊和多功能的產品。由于專用芯片組(標準化架構)的缺失,設計工程師需要在可 ...
2015年05月05日 10:31   |  
可穿戴設備   FPGA   低功耗   接口橋接  
FPGA實戰演練邏輯篇19:FPGA配置電路設計

FPGA實戰演練邏輯篇19:FPGA配置電路設計

FPGA配置電路設計本文節選自特權同學的圖書《FPGA設計實戰演練(邏輯篇)》配套例程下載鏈接:http://pan.baidu.com/s/1pJ5bCtt 我們所說的FPGA配置電路,一方面要完成從PC上把bit文件 ...
2015年04月29日 19:18
用Xilinx Vivado HLS實現浮點復數QRD矩陣分解

用Xilinx Vivado HLS實現浮點復數QRD矩陣分解

作者: Xilinx公司資深DSP專家 王宏強 Xilinx公司高級FAE 徐堅 鄧濤 Xilinx公司工具與方法學高級專家 徐天容 在數字信號處理領域,如自適應濾波、DPD系數計算、MIMO Decoder 等,常常需要 ...
2015年04月27日 14:30   |  
Vivado   HLS  
FPGA實戰演練邏輯篇18:FPGA時鐘和復位電路設計

FPGA實戰演練邏輯篇18:FPGA時鐘和復位電路設計

FPGA時鐘和復位電路設計本文節選自特權同學的圖書《FPGA設計實戰演練(邏輯篇)》配套例程下載鏈接:http://pan.baidu.com/s/1pJ5bCtt FPGA的時鐘輸入都有專用引腳,通過這些專用引腳輸入的時鐘 ...
2015年04月24日 07:41
FPGA實戰演練邏輯篇17:FPGA電源電路設計

FPGA實戰演練邏輯篇17:FPGA電源電路設計

FPGA電源電路設計本文節選自特權同學的圖書《FPGA設計實戰演練(邏輯篇)》配套例程下載鏈接:http://pan.baidu.com/s/1pJ5bCtt 整個系統需要三檔不同的電源電壓,即3.3V、2.5V和1.2V。如圖3.13 ...
2015年04月22日 11:40
FPGA實戰演練邏輯篇16:FPGA核心板電路設計架構

FPGA實戰演練邏輯篇16:FPGA核心板電路設計架構

FPGA核心板電路設計架構本文節選自特權同學的圖書《FPGA設計實戰演練(邏輯篇)》配套例程下載鏈接:http://pan.baidu.com/s/1pJ5bCtt 核心板除了一顆昂貴的CycloneIII系列FPGA芯片外,電源、復 ...
2015年04月20日 10:57
FPGA實戰演練邏輯篇15:讀懂器件手冊

FPGA實戰演練邏輯篇15:讀懂器件手冊

讀懂器件手冊本文節選自特權同學的圖書《FPGA設計實戰演練(邏輯篇)》配套例程下載鏈接:http://pan.baidu.com/s/1pJ5bCtt 很多工科學生英文水平都比較差,看到英文就頭大。但是,要 ...
2015年04月17日 11:27

結合FPGA與DSP的仿人假手控制系統設計

仿人假手作為肢殘患者重獲人手功能的主要對象,具有重大的社會需求。理想的假手應具有人手的仿生特征,主要體現在假手構造、控制方式與環境感知3 個方面,但由于其有限的體積和復雜的傳感器 ...
2015年04月16日 11:31   |  
仿人假手   控制系統   模塊化設計   現場可編程門陣列  

FPGA實戰演練邏輯篇14:外設電路(IO應用)

外設電路(I/O應用)本文節選自特權同學的圖書《FPGA設計實戰演練(邏輯篇)》配套例程下載鏈接:http://pan.baidu.com/s/1pJ5bCtt FPGA器件擁有著豐富的I/O資源,它的可擴展性非常強 ...
2015年04月15日 17:57
在FPGA上優化實現復數浮點計算

在FPGA上優化實現復數浮點計算

作者: Michael Parker 高性能浮點處理一直與高性能CPU相關聯。在過去幾年中,GPU也成為功能強大的浮點處理平臺,超越了圖形,稱為GP-GPU(通用圖形處理單元)。新創新是在苛刻的應用中實現基 ...
2015年04月15日 14:51   |  
FPGA   浮點計算   GPU   OpenCL  
Xilinx 16nm UltraScale+器件實現2至5倍的性能功耗比優勢

Xilinx 16nm UltraScale+器件實現2至5倍的性能功耗比優勢

作者:Mike Santarini,賽靈思公司賽靈思雜志發行人() 臺積公司的16nm FinFET工藝與賽靈思最新UltraRAM和SmartConnect技術相結合,使賽靈思能夠繼續為市場提供超越摩爾定律的價值優勢。 ...
2015年04月13日 17:06   |  
UltraScale   UltraRAM   SmartConnect  

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